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基于CPLD的雙CCD驅(qū)動時(shí)序設(shè)計(jì)

Driving Circuit of Double CCD Based on CPLD

作者: 肖江艷;陸建榮;劉有軍 
單位:北京工業(yè)大學(xué)生命科學(xué)與生物工程學(xué)院,北京,100124
關(guān)鍵詞: CCD%驅(qū)動時(shí)序電路%CPLD%Verilog  HDL 
分類號:
出版年·卷·期(頁碼):2009·28·1(74-77)
摘要:

用雙電荷耦合器件(charge coupled devices,CCD)代替?zhèn)鹘y(tǒng)膠片作為光接收器,對CCD輸出的信號經(jīng)過A/D轉(zhuǎn)換、數(shù)據(jù)傳輸及顯示等處理,以實(shí)現(xiàn)齒科成像系統(tǒng)的數(shù)字化.本文提出了基于CPLD來實(shí)現(xiàn)CCD驅(qū)動脈沖產(chǎn)生的方法,借助Quartus Ⅱ開發(fā)軟件,運(yùn)用Verilog HDL硬件描述語言編程實(shí)現(xiàn)了CCD的驅(qū)動時(shí)序電路的設(shè)計(jì).仿真時(shí)序結(jié)果表明本設(shè)計(jì)可行,能夠產(chǎn)生穩(wěn)定的驅(qū)動脈沖.最后經(jīng)下載調(diào)試實(shí)際產(chǎn)生了對雙TCD1251UD型號的正常驅(qū)動信號.

參考文獻(xiàn):

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